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西安电子科技大学数字逻辑电路综合大作业

发布时间：2025-03-02 作者：国家开放大学浏览：0次

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姓名学号

西安电子科技大学网络与继续教育学院

2022 学年下学期

《数字逻辑电路》期末考试试题

（综合大作业）

题号	一	二	三	四	总分
题分	30	10	30	30
得分

考试说明：

1、大作业试题公布时间：

（1）毕业班：2022 年 10 月 21 日；（2）正常班：2022 年 11 月 18 日； 2、考试必须独立完成，如发现抄袭、雷同均按零分计；

3、答案须用《西安电子科技大学网络与继续教育学院 2022 秋期末考试答题纸》（个人专属答题纸）手写完成，要求字迹工整、卷面干净、整齐；

4、在线上传时间：

（1）毕业班学生于 2022 年 10 月 21 日至 2022 年 11 月 1 日在线上传大作业答卷；

（2）正常班学生于 2022 年 11 月 18 日至 2022 年 12 月 5 日在线上传大作业答卷； 5、拍照要求完整、清晰，一张图片对应一张个人专属答题纸（A4 纸），正确上传。

一、单项选择题（每小题 2 分，共 30 分）

1、与八进制数(24.4)8 对应的二进制数是（）。

A．(10101.1)₂ B．(10110.1)₂ C．(10100.1)₂ D．(11011.01)₂

2．将(01000011.00101000)_5421BCD 转换为八进制数为（）。

A．(43.25)₈ B．(53.2)₈ C．(35.25)₈ D．(56.5)₈

3、若输入变量 A、B 只有全为 1 时，输出 F=0，则其输入与输出的关系是（）。

A．异或 B．同或 C．或非 D．与非

4、逻辑电路如图 1.1 所示，其输出函数 F 为（）。

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5、逻辑函数用卡诺图化简时，八个逻辑相邻项合并可消去（）。

A．一个变量 B．二个变量 C．三个变量 D．四个变量

6、 F = AB + 西安电子科技大学数字逻辑电路综合大作业的最小项表达式是（）。

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11、在下列逻辑电路中，属于组合逻辑电路的是（）。 A．寄存器 B．编码器 C．触发器 D．计数器12、所谓同步计数器是指（）。 A．各触发器的时钟端连在一起，统一由系统时钟控制 B．可用前级的输出做后级触发器的时钟 C．由同类型的触发器构成 D．可用后级的输出做前级触发器的时钟

13、为使 JK 触发器的状态由 0 到 0，其激励端 JK 取值为（）。

A．x0 B．0X C．x1 D．1x

14、四位移位寄存器现态为 1101，左移进两个 0 后再右移进一个 1。其移位寄存器的状态是（）。

A．0110 B．0111 C．0100 D．1010

15、74LS161当Cr = 1; LD = 0; P = 1;T = 1。其功能是（）。

A．计数 B．预置数 C．清零 D．保持

二、填空题（每小题 2 分，共 10 分）

16、开路门输出并联完成逻辑功能。

17、一个自然二进制码为 1110，该格雷码是。

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三、分析题（每小题 10 分，共 30 分）

说明：中规模器件 74LS90、74LS161 和 74LS194 的功能见附页21、由双 4 选 1 数据选择器组成电路如图 3.1 所示。

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①写出输出函数 F₁、F₂ 表达式；

②列出真值表；

③说明其功能。

22．电路如图 3.2 所示。

①分别列出图所示电路的状态迁移关系；

②分别指出电路的功能。

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23、由四选一数据选择器和移位寄存器 74LS194 组成电路如图 3.3 所示。

①列出 74LS194 的状态迁移关系；

②写出输出 F 的序列信号。

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四、设计题（每小题 10 分，共 30 分）

24、用 74LS138 译码器和少量的门电路设计一个转换电路，将输入的三位格雷码 G2G1G0
转换为三位二进制 B2B1B0。
①列出真值表；
②画出逻辑图。
25、试用 74LS161 设计一个起始态为 0100 的 9 进制计数器。
①列出状态迁移表；
②画出逻辑电路图。

26、利用 JK 触发器设计同步三进制加法计数器。
①做出状态迁移表；
②确定每级触发器的激励函数；
③画出逻辑图。

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